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CPLD/FPGA 博客分类

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  • 时钟分频改为使能分频

    2010/3/16 21:49:43

    一个模块的时序仿真是正确的，但当把这个模块放到顶层模块和其他模块一起仿真时，结果就出现了时序错误。我检查了一下，发现我的其他个时钟是由一个时钟分频得来…

    博客：wang5227004 | 类别：CPLD/FPGA | 评论：0

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  • FPGA综合工具Synplify下载与破解[原创]

    2010/3/16 16:55:52

    FPGA综合工具Synplify下载与破解[原创]SynplifyPro 针对复杂可编程逻辑设计的功能强大的 FPGA 综合工具 Synplify Pro 是 Synplicity 公司的FPGA 综合软件。在2001年，DataQquest 的…

    博客：lengqiang | 类别：CPLD/FPGA | 评论：0

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  • FPGA实现I2C总线模块（转）

    2010/3/16 16:47:04

    摘要：简述了I2C总线的特点；介绍了开发FPGA时I2C总线模块的设计思想；给出并解释了用VerilogHDL实现部分I2C总线功能的程序，以及I2C总线主从模式下的仿真时序图…

    博客：camfence | 类别：CPLD/FPGA | 评论：0

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  • 关于inout口的使用（转）

    2010/3/16 16:36:20

    芯片外部引脚很多都使用inout类型的，为的是节省管腿。一般信号线用做总线等双向数据传输的时候就要用到INOUT类型了。就是一个端口同时做输入和输出。 inout在具体实…

    博客：camfence | 类别：CPLD/FPGA | 评论：0

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  • 如何破解Synplify Pro 9.6.2? (SOC) (Synplify)

    2010/3/16 16:34:59

    如何破解Synplify Pro 9.6.2? (SOC) (Synplify) 本文介紹如何破解Synplify Pro 9.6.2。Introduction Step 1： 安裝Synplify Pro Step 2： 選擇Floating (License is on a license server) Step 3： 稍後會設定SYN…

    博客：lengqiang | 类别：CPLD/FPGA | 评论：0

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  • NEEK 烧录flash 方法

    2010/3/15 20:22:18

    NEEK 烧录flash 方法--yw—2010.03.14本篇所述的方法可进行对界面的修改，烧录flash，达到移植的目的。一、 进行界面调试1. 运行一系列命令1）.Create a BSP a. 切换到 application…

    博客：yw2010 | 类别：CPLD/FPGA | 评论：0

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  • NEEK Creating Flash files 产生flash 文件

    2010/3/15 20:19:53

    Creating Flash files 产生flash 文件1. 将eek.sh 文件拷入<elf_file>.elf <sof_file>.sof文件夹中 2. 运行 ./eek_rc .sh <elf_file>.elf <sof_file>.sof 3. 产生.flash 文件， xx_sw.flash xx_hw.flash

    博客：yw2010 | 类别：CPLD/FPGA | 评论：0

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  • ISE 约束文件的基本操作(转载)

    2010/3/15 17:03:40

    按：早就想研究一下fpga约束设置，现在总算有时间静下心来看看了1．约束文件的概念 FPGA设计中的约束文件有3类：用户设计文件（.UCF文件）、网表约束文件（.NCF文…

    博客：lengqiang | 类别：CPLD/FPGA | 评论：0

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  • ModelSim SE 6.5下载及安装步骤

    2010/3/15 9:58:21

    ModelSim SE 6.5下载及安装步骤 ModelSim SE 6.5下载及安装步骤1 ModelSim SE 6.5下载在ModelSim网站www.model.com下载ModelSim SE 6.5源文件，进入www.model.com后，进入DO…

    博客：lengqiang | 类别：CPLD/FPGA | 评论：0

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  • modelsim force 命令

    2010/3/15 5:12:47

    force命令在modelsim常用来信号赋值，较为常用，故此备份 force din 16#40900000 0 --从当前时刻起，给din赋值force bus 16#F @100ns --在100ns时刻，给bus赋值force clk 1 10ns, 0 20ns -re…

    博客：lyle | 类别：CPLD/FPGA | 评论：0

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  • 永远忠于年轻时的梦想

    2010/3/14 14:47:29

    永远忠于年轻时的梦想 本来我也不知道最后的两课该以怎样的方式来讲，也不是很确定什么时候能够静下心来录。最近遇到了很多事，开心的不开心的，其实也无所谓开心…

    博客：ilove314 | 类别：CPLD/FPGA | 评论：5

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  • Learning the Altera Avalon Verification IP Suite

    2010/3/13 8:40:49

    Here is the description of the Avalon VIP Suite and the advantages of using it. The Avalon Verification IP Suite provides bus functional models (BFMs) to simulate the behavior of Avalon Memory-Mapped (Avalon-MM) m…

    博客：riple | 类别：CPLD/FPGA | 评论：0

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  • Virtual JTAG仿真操作

    2010/3/12 18:36:47

    Virtual JTAG仿真操作 Riple兄也曾就Virtual JTAG仿真写过博文《Virtual JTAG仿真要点》，文章中就VJI的仿真原理和基本操作概念做了详细的介绍。《Virtual JTAG Megafunction User …

    博客：ilove314 | 类别：CPLD/FPGA | 评论：1

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  • cvs 命令

    2010/3/12 13:38:14

    常用的cvs命令 CVS的常用命令速查手册 发布： Linux 分类： Linux 发布日期： 2005.06.22 作者： 车东 chedong@bigfoot.com 概述：CVS是一个C/S系统，多个开发人员通过一个中心…

    博客：antilope | 类别：CPLD/FPGA | 评论：0

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