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汶川地震捐助____一基金支付宝捐助方式
条件:有支付宝帐户,且有余额超过1元,能够顺利上网
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标签: 汶川 地震 捐助 一基金 支付宝
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用cpld做波特率发生器

--用于将主频分为16倍波特率的频率
library ieee;
use ieee.std_logic_1164.all;
use ieee.std_logic_unsigned.all;

entity maxii_clk is
  port(
  clk_in   : in  std_logic;     --22.1184
  clk_uart : out std_logic
      );
end maxii_clk;

architecture a of maxii_clk is
 CONSTANT d1 : integer :=72; 
 CONSTANT d2 : integer :=143;
 CONSTANT d3 : integer :=71; 
 signal cnt  : std_logic_vector(7 downto 0);
 signal con_o: std_logic;
begin
--以下实现分频达到波特率16倍对应的频率
  process (clk_in)
  begin
 if clk_in'event and clk_in='1' then
     
  if cnt < d1 then
   con_o <= '0';
   cnt<=cnt+1;
  elsif cnt < d2 and cnt > d3 then
   con_o <= '1';
   cnt<=cnt+1;
  else
   con_o <= '0';
   cnt(7 downto 0) <= "00000000"; 
  end if;
    end if;
  end process;
  clk_uart <= con_o;
end a;
-------------------------------------------------------------------------
-- 主频率   |  波特率 |  16倍  |  d1  |  d2    |  d3  --
-------------------------------------------------------------------------
-- 22.1184  |  9600 |  153600 |  72  |  143 |  71  --
-- 22.1184  |  19200 |  307200 |  36  |  71 |  35  --
-- 22.1184  |  38400 |  614400 |  18  |  35 |  17  --
-- 22.1184  |  57600 |  921600 |  12  |  23 |  11  --
-- 22.1184  |  115200 |  1843200 |  6   |  11 |  5   --
-------------------------------------------------------------------------
-------------------------------------------------------------------------
-- 主频率   |  波特率 |  16倍  |  d1  |  d2    |  d3  --
-------------------------------------------------------------------------
-- 11.0592  |  9600 |  153600 |  36  |  71 |  35  --
-- 11.0592  |  19200 |  307200 |  18  |  35 |  17  --
-- 11.0592  |  38400 |  614400 |   9  |  17 |   8  --
-- 11.0592  |  57600 |  921600 |   6  |  11 |   5  --
-- 11.0592  |  115200 |  1843200 |   3  |   5 |   2  --
-------------------------------------------------------------------------

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系统分类: CPLD/FPGA
用户分类: 其他
标签: maxii cpld 分频 波特率 发生器
来源: 原创
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我们集资的9260开发板

9GSAM9260EK开发板简介


AT91SAM9260特性
 带Java扩展的ARM926EJ-S内核, 2 x 8KB快速缓存, MMU内存管理单元
■ 2x4 KB SRAM, 32 KB Boot ROM
■ 180 MHz时200 MIPS
■ EBI总线可支持SDRAM, NAND Flash (带ECC)和Compact Flash CARD
■ 外设可支持DMA和FIFO,集成复位控制电路,高速中断
■ USB主控制器和USB从设备口, V2.0全速12M
■ Ethernet MAC - 10/100M
■ 图像传感器接口,10BIT接口,支持SAV和EAV
■ 一个 SSC可支持I2S和TDM
■ 两个 SPI, MCI (SD Card和MMC兼容), TWI
■ 六 USART, 支持IrDA, ISO7816 T="0/T"=1, RS-485 RS-232 IRDA
■ 一个调试UART
■ 4-通道 10位ADC
■ 带实时时钟的备用电池供电的下电模式
■ 1个主时钟,1个32.768K时钟, 2 PLL和RTC
■ 3.0到3.6V IO电源,1.65到1.95V内核电源, 3.0到3.6V或1.95到3.0V 存储器电源接口
■ JTAG和边际扫描
■ PQFP-208和LFBGA217
开发板特性:
MPU
 at91sam9260(PQFP,无铅产品)
存储器
■256MB 8位 NandFlash
■64MB  两片16位 SDRAM
■4MB DataFash
电源(Power)
■USB从设备口取电
网络(Ethernet)
■一个10/100M网口,带网络变压器的RJ-45接口和板上LED指示灯
USB Host端口
■一路USB 2.0 全速12M Host端口
■支持U盘、鼠标、键盘、摄像头、打印机 等设备
USB Device 端口
■一路USB 2.0 全速12M Device端口
串口(USART)
■一个三线串口,一个五线串口,USART支持RS485和ISO7816协议
Dbgu调试口
■一个专用调试串口
实时时钟
■带后备电池的RTC
■一路CAN-Bus接口,支持CAN2.0A/B协议
■一个SD卡接口(四线方式)
■外接SPI和I2C接口
■外接简易EBI接口,可接LCD
■一路AD接口,板上可调电阻
■一路音频接口
■四个独立GPIO口按键
■一个外置硬件看门狗和电源电压检测
■JTAG调试接口
■USB器件接口固化代码模式

当前版本9GSAM9260EK-2.0
icon现促销价1100RMB

11:12:08 UTC+0800

系统分类: ARM
用户分类: 其他
标签: 9260 arm9 开发板 工业控制 ARM设计
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Google的骗钱技巧
Google的骗钱技巧是非常高明的,它巧妙掌握了广告主和个人站长的弱点,通过Google AdWords和Google AdSense结合,达到了这个目的。单从个人站长这块来保守的计算,骗上一个就增加几百到几千美元的收入,一年在全世界骗上几万个站长,就增加几亿美元的收入。大家在Google公开的财报中看到,Google AdSense占总收入的比例越来越要,这与Google的欺骗技巧有非常大的关系。
 
    废话不多说,直接讲Google如何利用个人站长和广告主的弱点进行高手法骗钱的:pdf
系统分类: 自由话题
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标签: 骗钱 google 技巧 adsense AdWords
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我的那个彩屏控制器cpld的彩条发生程序

伪彩液晶屏lcm32c041的彩条发生程序

彩条因为没有用到sram所以没有试验中出现雪花的问题,但是太简单了,以前没好意思放上来,后来经常有人问那我就先放上,没有过多的注解,敬请见谅。

简单解释,基本情况是屏有320*240,但是有相当数量的前导数据存在,所以总共的脉冲数要超过320*240,程序用vhdl写的,mpii与qii皆编译过,但是多少条实在不记得了有文件rar在此,以供探讨.

系统分类: CPLD/FPGA
用户分类: 其他
标签: lcd驱动 cpld 彩条 vhdl 源码
来源: 原创
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深圳公交线路
pdf对这个没啥好发言的,公交线路与其经过的站点的统计。
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cpld

cpld=>lcd

本设计的最初想法是设计一个伪彩屏的控制器.最初采用max7128(因家里还有一些),最终因资源不足流产,后看到上海某国企出产的伪彩屏采用89c51,本人又采用mage设计了一版,成功了到是,就是速度约20k(原设计的最大能力分析为200k,但由于程序解码原因实测仅达到20k),有点不尽如人意.现又以epm240重新设计,现在板子还在生产中,预期速度可达到3M并行速度,这样还是可以认可的.现说明一下最新情况,因测量不慎将高压引入lcd和cpld,又进了一块lcd,延误了几天,现在已经完工,情况如下:

epm240宏单元用去190个,管脚58只,实机测试速度200k,因暂时手头只有51可用,其p0口在应用中高电平上升很慢,约需5us,故采用p1口传输数据,现图形显示在前端还正常,后端不知何故总要多出几个数据,造成后端有扫帚纹,考虑可能由于数据线过长(60cm)造成,总之还有待测试.另图已整理完毕.

系统分类: CPLD/FPGA
用户分类: 其他
标签: 无标签
来源: 无分类
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