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以下是关于标签 verilog 的列表
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  • Verilog HDL 中时间尺度 2008-5-9 20:34:54

    `timescale是Verilog HDL 中的一种时间尺度预编译指令,它用来定义模块的仿真时的时间单位和时间精度。格式如下:`timescale 仿真时间单位/时间精度注意:用于说明仿真时间单位和时间精度…

    博客:likee | 类别:CPLD/FPGA | 评论:0

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  • pipiline加法器 2008-4-15 18:07:11

    Pipeline:如果直接 {cout,sum}=ina+inb+cin; 构成一个并行的加法器,会消耗较多资源。而pipeline只是加了一些中间寄存器,把复杂的8位运算分成4个2位运算,求第一个结果需要延时4个周期,…

    博客:cqcrr | 类别:CPLD/FPGA | 评论:0

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  • Verilog描述的8051的程序集合包 2008-4-10 19:43:36

    Verilog描述的8051的程序集合包很有意思,用Verilog描述8051,有很多的分模块,大家自己看吧.程序比较多,就不提供在线阅读了,下载后慢慢消化吧主要的程序有:下载区:

    博客:mycaibo | 类别:CPLD/FPGA | 评论:0

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  • 基于FPGA的并行CRC的研究 2008-2-25 20:41:32

    相信在的系统中CRC校验已经是个司空见惯的设计。本文总结了CRC的常规设计思路,并提供给各位同僚一个绝佳的并行CRC在线生成的工具。方便生成任意的CRC校验的Verilog 和VHDL源…

    博客:wwh_nuaa | 类别:CPLD/FPGA | 评论:4

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  • FPGA之Verilog延时 2008-1-22 17:43:41

    最近在弄nandflash,基本完善,发现以前的delay太啰嗦,但就这样挂着吧,算是自己的脚丫了。 最终发现,这种瞬间上升沿触发的模块在实际应用中无法综合成delay电路,瞬间上升沿触发的捕…

    博客:ostrich1983 | 类别:CPLD/FPGA | 评论:0

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  • CIP-51 TM内核设计 2007-12-29 22:52:36

    CIP-51TM 内核设计 两部分关键:取指 (指令预取) 执指 (指令操作)CIP51-TM 109 指令 80~ff为特使功能的寄存器 Clocks to Execute 指令执行周期 1 2 2/3 3 3/4 4 4/5 5 8 Number of Instructions 对应指令条目 2…

    博客:wwh_nuaa | 类别:CPLD/FPGA | 评论:0

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  • UltraEdit Verilog语法高亮文件 2007-12-1 17:36:54

    UltraEdit Verilog语法高亮文件我本人不使用UE ,我更习惯使用PsPad 。我这边也有PsPad的Verilog SystemVerilog的 语法高亮文件。需要的话mail to me : wwh_nuaa@163.com.谢谢你的支持,记得顶一下…

    博客:wwh_nuaa | 类别:CPLD/FPGA | 评论:2

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  • 全遍历LFSR 2007-11-29 19:07:24

    老师说只能遍历2n-1个随机数字,我改了一下,改成2n个遍历.相关verilog代码如下,希望师兄师姐们多多指导.我学微电子快三个月了.觉得挺不错的。先去上低功耗的课了.module ran_reg_bas_mod(inp…

    博客:scuay | 类别:汽车电子 | 评论:0

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