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Quartus II 6.0破解(完整版)
    虽然有点老了,不过还是有点用!

首先第一种情况您下载的文件中有crack这个文件夹,并且有下面的英文破解说明和文件,如果没有,可以自动忽略这种情况,看第二种和其他一些软件一样,破解文件放在crack文件夹里,里面里有下面的英文破解说明,不过理解起来有些费劲,好不容易弄好了,解释如下

下面是英文破解说明

1.) Install the Product you want (Windows/Linux/Solaris)
2.) Copy the Cracked librarys into the main binary directory:

Example:
INSTALL\win
INSTALL\linux
INSTALL\linux64
INSTALL\solaris
INSTALL\solaris64

3.) Edit license.dat and change "CHANGEME" to any type of hostid for your system:

Example:
HOSTID=00f0ffc0000f :Ethernet
HOSTID=10018a3d          :DiskID

4.) Point the program to license.dat when asked.
5.) Enjoy

Have Fun Team NiTROUS and Team SHooTERS !

解释一下:
windows下安装完成后,将crack文件夹中windows文件夹的alterad.exe和sys_cpt.dll拷贝到quartus60目录的win文件夹中覆盖原来的同名文件,为以防万一可以事先备份一下,然后将crack文件夹中的license.dat拷贝到硬盘的某一目录下,命令行下(开始菜单-运行-cmd可得)用ipconfig /all命令得到本机MAC地址(Physical Address)(00开头的12位数值),用文本编辑文件如ultraedit打开license.dat,将里面的CHANGEME字段替换为本机MAC地址,打开quartus软件,如果出现注册的对话框,选择第三项,导入这个license.dat即可!

其实获得MAC地址还可以在导入之时看一下导入对话框最下面的显示,下面两个显示值上面的是MAC地址,下面的是硬盘号。

那天这样做过后,显示是已经注册了,不过很不幸,我运行一个实例时,出现了一个提示lisence is not valid,让人觉得很是郁闷,半天功夫岂不白费?或许是我理解不到位,不过我按照这种方法没有成功,哪位大侠成功了,不妨告诉小弟一声,提前谢谢了

第二种方法没有crack文件

没办法,只好又到网上搜索,终于在另一个bbs(欣欣工作室)上找到另一个lisence文件,照其说明修改导入后,这个实例终于没有出错!

下载地址

http://www.xinworks.com/confirmdown.php?id=310
Crack_QII60_b178.rar

里面有详细说明,仍然是将sys_cpt.dll拷贝到quartus60目录的win文件夹中覆盖原来的同名文件,为以防万一可以事先备份一下,
如果已经替换sys_cpt.dll文件,可以将下面内容存成lisence.dat,命令行下(开始菜单-运行-cmd可得)用ipconfig /all命令得到本机MAC地址(Physical Address)(00开头的12位数值),用文本编辑文件如ultraedit打开license.dat,将里面的CHANGEME字段替换为本机MAC地址,打开quartus软件,如果出现注册的对话框,选择第三项,导入这个license.dat即可!

license.dat文件内容:

FEATURE quartus alterad 2034.12 permanent uncounted 385FB2185EE1 \
HOSTID=XXXXXXXXXXXX SIGN="1113 5A52 EA34 2C59 C5B7 B031 \
CE45 D947 B4AB 5969 C1E6 913F DE27 F3FE 08B7 07E0 9AF1 4546 \
392F BDEF 2D19 E184 8A44 4C38 FD10 88F9 0F2F 1E21 5754 B8E8"

FEATURE quartus_stratixgx_2 alterad 2034.12 permanent uncounted \
00812F178F89 HOSTID="XXXXXXXXXXXX" SIGN="1A84 B0B6 D972 \
5229 EC39 B3DC A8C3 283E 67DF 23C8 A1C1 3D93 5B16 FE89 8E89 \
1134 00E6 C6BA D317 1C3E 6DE5 27F2 B081 328A 4C92 B9D6 4531 \
27E3 096A CE99"


#license文件存放的路径名称不能包含汉字和空格,空格可以用下划线代替。
#把license.dat里的XXXXXXXXXXXX用您老的网卡号(MAC地址)替换,仅限于学习,不要用于商业目的!

经本人实践,第二种方法成功。

下面转一个QuartusII 6.0 + NiosII 破解经验,仍是欣欣工作室里的

http://www.xinworks.com/bbs/simple/index.php?t942.html

近两日,破解QuartusII 6.0 + NiosII ,在本站查找相应资料,经过测试,以下方法可行:

Crack_QII60_b178.rar :来源 main(void) 的 QuartusII 6.0 破解器

按提示安装文件 sys_cpt.dll 和 license.dat 可破解 QuartusII 6.0 sp1

再将以下文字增添入 license.dat 文件中,可破解 NiosII 6.0 限时版


FEATURE 6AF7_00A2 alterad 2010.01 permanent uncounted C601466C3C65 \
         VENDOR_STRING="iiiiiiiihdLkhIIIIIIIImPDuiaaaaaaaaP1X38DDDDDDDDmjz5cdddddddd4mGzGJJJJJJJJiqIh0uuuuuuuucYYWiVVVVVVVVcp0FVHHHHHHHHPUEakffffffffR2FFRkkkkkkkkqL$84"\
         HOSTID="xxxxxxxxxxxx" SIGN="1F1B DB90 1CF0 E27C 5F38 074E 2DC6 \
         BEB9 9A29 39D5 1335 E638 E2E7 39A7 8538 1DFC 8038 974A 77E4 \
         BB8E 7931 6FC3 07FA 910C B0DD 93D7 E1C4 4FA2 9E86 D5B2"


此段文字来源于本网站某位大侠提供的 license, 再此特别致谢!

别忘啦修改其中的 HOSTID 呦

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EasyCpld570 部分源程序

  下图是EasyCPLD570的部分源程序列表,大家可以看看!

http://auction1.taobao.com/auction/0/item_detail-db1-4f4e6915b70fcdbdc72a6bb2b150f0e9.jhtml

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ALtera CPLD/FPGA 入门级开发板 EPM570

http://auction1.taobao.com/auction/0/item_detail-0db1-4f4e6915b70fcdbdc72a6bb2b150f0e9.jhtml

Easy570 学习板是ITSN最新开发的一款Altera入门级的CPLD学习板子。

1. 选用Altera公司MAX II 系列的CPLD,具有最低的动态功耗,具有高容量、高性能。
2. 实时在系统编程(ISP),通过下载线下载程序,使得调试程序更加方便,减少编程停机时间。
4. I/O断口全部连出,极大方便用户进行扩展实验。
5. 随机提供全套开发软件。

Easy570 CPLD开发板功能:

1. 数码管动态, 静态显示
2. 8个LED流水灯
3. 4×4 矩阵键盘
4. 1×5 IO键盘
5. 8×8 LED点阵
6. VGA接口
5. RS232串口通讯
7. PS2键盘接口
8. 8位拨码开关输入
9. I2C接口
10.24M,50M两个时钟源


套件包括:

1. Easy 570 CPLD学习板
2. 一根串口数据线
3. RS232串口数据线一条
4. 配套DVD光盘一张(包含最新的QUATUSII7.2, NiosII 7.2, ModeSim 7.2, DSP Buider 7.2, 测试程序,PDF格式原理图,相关技术文档,数据手册)

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Altera CPLD EPM570 入门级实验----流水灯(已经验证)

  Altera CPLD EPM570 入门级实验----流水灯(已经验证) ,源码如下:

程序代码如下:

LIBRARY IEEE;
USE IEEE.STD_LOGIC_1164.ALL;
USE IEEE.STD_LOGIC_UNSIGNED.ALL;
USE IEEE.STD_LOGIC_ARITH.ALL;

ENTITY maxii_lamp2 IS
  PORT(
    clk     : IN STD_LOGIC;
    leddrv  : OUT STD_LOGIC_VECTOR(7 DOWNTO 0)
  );
END maxii_lamp2;

ARCHITECTURE maxii_lamp2 OF maxii_lamp2 IS
  SIGNAL reg : STD_LOGIC_VECTOR(7 DOWNTO 0) :="00000001";
BEGIN
 
  leddrv <= reg;

  PROCESS(clk)
    VARIABLE cnt : INTEGER RANGE 0 TO 50000000 :=0;
  BEGIN
    IF clk'EVENT AND clk='1' THEN
      cnt := cnt+1;
      IF cnt="50000000" THEN
        cnt := 0;
        reg <= reg(6 DOWNTO 0)&reg(7);
      END IF;
    END IF;
  END PROCESS;

END maxii_lamp2;

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CPLD入门级开发板图片

流水灯实验

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