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发表于:2008-5-10 20:54:01
标签:云计算  并行  处理  

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小谈“云计算”

  当看到IBM和Google联合开发分布式计算能力的“云计算”时,心里高兴了一下,终于这个方向有人开发了。
 
  并行计算的初衷就是加速计算,但受到过程本质顺序性的流程限制,加速度有限。
随着计算能力的普及(智能手机),开始考虑的不仅仅是并行加速,而是计算任务的转移。这也使得手机完成更多更复杂的任务成为可能。

  现在最欠缺的就是安全性,我的想法就是让进程传递变成不可逆的,让信息变成不完整。然后就是谁主张谁负责,路由由运算发起者来负责,这样经过一层抽象的话就将信息对外隐藏了。路由时可以按照运算能力优先级的方式来分配运算能力。

  便携设备也是有底线的,逼近很多任务是不能代劳的,显示等基本I/O能力是不能缺少的,所以像MPEG之类的解压缩都必须本地完成,网络的瓶颈也加重了压 缩解压缩的压力。所以从整体的角度来看,计算能力要求是两头小中间大的情况,而中间部分的计算任务被并行处理了(通过网路转移了)。

  云处理(借用一下这个名词)有很好的应用前进,但还有很长的路要走,还有不少技术细节为解决。衷心希望该技术能早日成熟起来。

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发表于:2008-2-14 20:43:56
标签:无标签

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有线通调制解调器对手机的干扰

       原来一直很好的CDMA信号,有阵子开始不明原因的打不出电话、手机发烫,但手机上的信号依然显示较好,自己分析是上行线有干扰。

       由于昨晚手机没关,一早被个电话吵醒,于是我开始怀疑起自己房间里有干扰源,一路路电源排查过来,就是有线通调制解调器(DVT-2150)。拆开一看,估计不是高频头就是电源的开关噪声。对于CMDA来说表现为随机噪声,这也解释了为什么手机信号依然显示为很好。

       于是,自己动手开始改造,买了包口香糖,用铝箔纸在机壳内做了一屏蔽。但由于屏蔽层没有办法做接地,所以效果不是很理想。

       最后,不得以将调制解调器请出我的房间,铺了路电源,做个15米网线,将干扰源限制在刚进家门的地方。总算解决了这个问题。天晓得这设备怎么过EMC测试的。

为此,还特意查了下相关的干扰问题:

http://www.cellphone.eetchina.com/ART_8800289434_2000001_TA_f8721f92.HTM

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发表于:2008-2-11 1:24:56
标签:ARM  CPU  RISC  parallel  Cluster  

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CPU演化随想

看到ICS的广告中的虚拟场景,让我不禁反问自己“当处理器速度达到可以欺骗人的感官的时候,我们又何去何从,难道真的会想《机械公敌》一样吗?”

言归正传,这两天在写arm7的程序,以前会觉得比较轻松,但自从看了卓越编程后就有点缩手缩脚了,处处要考虑编译后的效率……哎,可能是理解的还不透彻吧。但从另一个方面,我又发现RISC有点穷途末路,在我做高速ad采样设计的时候发现,限制一切硬件的本质是时钟,时钟本身的震荡自然不是太大的问题(就我所知最高的有光电震荡呢,10GHz),而是电路的承受能力了,就是所谓的漏电流引起的功耗问题,这很大一部分涉及工艺问题,而RISC试图以简单的结构来提升电路的频率及降低功耗,后者相对来说还是成功的,但前者并未看到有明显的作用。
就arm的汇编来说,我觉得和C的思考方式还是有很大差距的,而且我很少看到arm用纯汇编写的,换句话来说MCU始终没有最高效的工作过。或者我对编译的优化还不够了解,但对于大数据的搬移来说,编译效果不让人满意。综上所述,RISC在现有C的编写方式写并没有发挥其多寄存器的优势,相反被它的多周期操作而拖累。当然在这里我不想批评点什么,只是觉得还有工作有待完成。

在处理器频率的标高收到限制的时候,自然而然的想到了扩大规模,单纯的拓展指令集的效果有限,那么double就很自然了。但是CPU的double似乎有点不彻底。
内核两个了,但其他外设呢?共享!
我依然感觉两台电脑要比双核来的快。为什么呢?我琢磨着……
共享的方式出了问题,他们共享的不光是内存(数据),他们连程序都共享了,也就是说两个内核被当作以个处理器来处理任务,这使得两个处理器的任务相关性很大,因为我们的习惯思维总是顺序进行的,致使任务中数据的时间纵向相关性很大。因此,我觉得即使4核了,处理能力也没有线性增加。这也部分解释为什么四路单核服务器比两路双核服务在处理大数据量的时候要快。

我对多核的连接提出个新的观点:核与核之间以最快的方式进行连接——寄存器连接(通过寄存器交换数据),而独享其他的外部资源,也就是说4核需要4个硬盘,听起来有点疯狂,不过看到PCI-E的固态硬盘后也许会觉得还是有可能的。
多的硬盘就表示有多段程序在同时运行,希望各自独立运行,而非频繁的交换数据。这又让我想到了内核特殊化,就是每个内核都有自己处理任务的强项同时需要时又能分担一部分处理任务,这点到有点双A计划(AMD+ATI,GPU+CPU),这里关键是独享慢速设备。
同时如果在最顶端进行数据交换的话,就使得处理器间的关系就更透明了,内核1只要问内核2要他的数据而不用了解他的数据怎么存放的。当然这样也会使处理器的有效效率降低,或者设计个自动搬移数据的指针来解决。
这样就相当于以寄存器连接的集群机一般工作,自然也很大程度缓解集群中网路瓶颈问题。这样的结构更适合多进程的情况,而不是多线程。

P.S.以上仅是一时兴起的随想,有诸多不严谨处尽请原谅,仅抛砖引玉。

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