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最新日志

发表于:2007/7/29 17:55:54
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水货和行货

何谓行货呢？行货就是得到生产厂商的认可，由某个商家取得代理权或者直接 由该生产厂商的分支机构在某个指定的地区进行销售的产品，由于行货需要让代理 商及其分支机构获得合理甚至是暴利的利润，而且必须缴纳符合该地区政府要求的 关税和税款，因此行货的价格往往比较高，但是因为正式的当地代理厂商，产品的 售后服务往往较有保障，产品原配的驱动程序、说明书和操作系统往往也会和销售 地区的语言相同。 那么何谓水货呢？水货就是原本不应该在某地区销售的品种在某地区销售，或 者是绕过某…

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发表于:2007/7/17 21:56:16
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让心休息一下

第一题： )Ps @-]/`GuestEDA中国门户网站iz \:p*K)f9]X6\!W 　　一只小狗带了足够多的水和食物到沙漠旅行(没有天敌等危害)，结果在第EDA中国门户网站~S8G2kp!e@ 　　二天就被发现已经死了，请问是什么原因？ 6GTN"oq]L+|AGuestEDA中国门户网站:O't ^1NY`*AY 　　答案：想尿尿却找不到电线杆，结果憋死了(我答的是被太阳晒死了---错)。EDA中国门户网站b[9asM:Em EDA中国门户网站&n&tf,vms h wB3^ 第二题： sek&Y3z4\dqGuestEDA中国门户网站%\…

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发表于:2007/7/14 12:27:53
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[转]基本触发器

一、触发器的概念 复习：组合电路的定义？构成其电路的门电路有何特点？组合电路与时序电路的区别？门电路：在某一时刻的输出信号完全取决于该时刻的输入信号，没有记忆作用。触发器：具有记忆功能的基本逻辑电路，能存储二进制信息（数字信息）。触发器有三个基本特性：（ 1 ）有两个稳态，可分别表示二进制数码 0 和 1 ，无外触发时可维持稳态； （ 2 ）外触发下，两个稳态可相互转换（称翻转）， 已转换的稳定状态可长期保持下来，这就使得触发器能够记忆二进制信息，常用作二进制存储单元。 4.2 …

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发表于:2007/7/4 22:04:50
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中国半导体行业协会06年十大半导体企业统计结果

为全面总结2006年国内各有关半导体企业所取得的成绩，依据参加全国半导体行业统计企业的上报数据，中国半导体行业协会分别排出2006年度国内10大集成电路设计企业、10大集成电路与分立器件制造企业以及10大封装测试企业，其结果如下： 排名 企 业 名 称 06年销售额（亿元） 一、10大电路设计企业 集成电路设计企业 1 炬力集成电路设计有限公司 13.46 2 中国华大集成电路设计集团有限公司*(包含北京中电华大电子设计公司等) 12.00 3 北京中星微电子有限公司 10.13 4 大唐微电子技术有限公司 9.19 5 深圳海思半导体…

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发表于:2007/6/30 23:19:37
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IC 专业术语

//真的很搞，本来以为离开学校后再也不会考试了，呵呵，但是到公司后还是不断的参加考试，下周更惨，一周就考三次，哈哈。没办法，有些东西还得准备，专业术语也考，早就忘光了。ASIC: Application Specific Integrated Circuit. 专用IC CPLD: Complex Programmable Logic Device. 复杂可编程逻辑器件 EDA: Electronic Design Automation. 电子设计自动化 FPGA: Field Programmable Gate Array. 现场可编程 门阵列 GAL: Generic Array Logic. 通用阵列逻辑 HDL: Hardware Description Language. 硬件描述语言 IP: Intelligent Property. 智能模块 PAL: Programmable …

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发表于:2007/6/22 23:49:40
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[转]Ncverilog 命令使用详解

我们知道，由于NC-Verilog使用了Native Compile Code 的技术来加强电路模拟的效率，因此在进行模拟时必须经过compile(ncvlog 命令）以及elaborate(ncelab命令）的步骤。编译之后，针对每一个HDL设计单元会产生中间表达。接着elaborate命令会建立整个电路的结构，产生可以用来模拟的资料。最后使用ncsim命令来进行模拟。 三命令模式 命令如下： ncvlog -f run.f ncealb tb -access wrc ncsim tb -gui 第一个命令中，run.f是整个的RTL代码的列表，值得注意的是，我们需要把tb文件放在首位，这样可以避免出现提示timescale的错误。…

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发表于:2007/6/20 23:19:23
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【转】AMBA、AHB、APB总线简介

AMBA简介随着深亚微米工艺技术日益成熟，集成电路芯片的规模越来越大。数字IC从基于时序驱动的设计方法，发展到基于IP复用的设计方法，并在SOC设计中得到了广泛应用。在基于IP复用的SoC设计中，片上总线设计是最关键的问题。为此，业界出现了很多片上总线标准。其中，由ARM公司推出的AMBA片上总线受到了广大IP开发商和SoC系统集成者的青睐，已成为一种流行的工业标准片上结构。AMBA规范主要包括了AHB(Advanced High performance Bus)系统总线和APB(Advanced Peripheral Bus)外围总线。 AM…

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发表于:2007/4/14 11:59:14
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冒个泡

呵呵，谢谢大家的支持，最近工作一直很忙，单位又不让上网，呵呵，所以很久没有来了，还是想出来冒个泡，说明我还在，呵呵，有时间再跟大家好好聊，OH！Yeah！呵呵

系统分类: CPLD/FPGA   |    用户分类: 有感而发    |    来源: 原创

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发表于:2007/3/20 15:57:43
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[转]消除FPGA设计中的毛刺问题

FPGA(Field Programmable Gate Array)以其容量大、功能强以及可靠性高等特点,在现代数字通信系统中得到广泛的应用。采用FPGA设计数字电路已经成为数字电路系统领域的主要设计方式之一。在FPGA的设计中,毛刺现象是长期困扰电子设计工程师的设计问题之一,是影响工程师设计效率和数字系统设计有效性和可靠性的主要因素。由于信号在FPGA的内部走线和通过逻辑单元时造成的延迟,在多路信号变化的瞬间,组合逻辑的输出常常产生一些小的尖峰,即毛刺信号,这是由FPGA内部结构特性决定的。毛刺现象在FPG…

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发表于:2007/3/15 19:04:02
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什么是亚稳态？

亚稳态是指触发器无法在某个规定时间段内达到一个可确认的状态。当一个触发器进入亚稳态时，既无法预测该单元的输出电平，也无法预测何时输出才能稳定在某个正确的电平上。在这个稳定期间，触发器输出一些中间级电平，或者可能处于振荡状态，并且这种无用的输出电平可以沿信号通道上的各个触发器级联式传播下去。1．亚稳态发生的原因 在同步系统中，如果触发器的setup time / hold time不满足，就可能产生亚稳态，此时触发器输出端Q在有效时钟沿之后比较长的一段时间处于不确定的状态，在这段时…

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发表于:2007/3/3 21:00:20
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[转]IC设计领域及其工种介绍

（一）模拟与混号讯号电路设计 cY1~{Kw5j,rgoldenlin 6V+J(hI}!?goldenlinIC 电路可分为为模拟 IC 与数字 IC 两大类，以及两者兼具的混合讯号等三种。模拟与数字的差异在于数字的讯号是以 0 、 1 的非连续方式传递、运算及储存。而模拟讯号则是以连续性的型式来传递，并作为数字讯号与最终使用者的桥梁。 s{4]3AQ @9[ |.tlPgoldenlin在 IC 设计领域中，模拟的人才最为缺乏，但相对而言模拟 / 混合讯号设计工程师的人才养成也最为困难，一般而言最起码需要 2 ～ 3 年的经验才能完全上手，但也因为人才养成…

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发表于:2007/2/27 10:35:23
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[转]国内微电子专业概况

微电子这个专业大家要注意,虽然很缺人,但国内基本上不会培养.因为这个专业的门槛比较高.你如果在一所差的学校学微电子,基本跟没学差不多.而且这个专业如果没有好的氛围,光凭自学没什么用.所以一定要练顶尖学校.微电子主要有两个大方向:设计和工艺,尤其设计很缺人.工艺应该是清华第一,北大第二.在设计方向的排名如下: 1.复旦大学微电子系:复旦是个传统的偏文的学校,工科大多数很烂,但却出了复旦大学微电子这个怪胎.全国五大集成电路公司的老总,三个是复旦的.拥有全国最好的实验设备,最优秀的师资.其实,…

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发表于:2007/1/31 20:48:26
标签：龙芯  

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[转]龙芯CPU考虑的策略

前言：我重贴旧文，是让大家留心里面有很重要一段，即“"Code Morphing"的二进制编译技术”那段。 凭借RISC指令集的先天优势，再加上INTEL所用的X86指令集继续提升性能方面的固有瓶颈，龙芯完全可能在性能上迅速接近INTEL的CPU。 但龙芯进军桌面电脑市场还有个问题，就是龙芯不能直接使用运行在PC上的与X86兼容的程序。 当然我们可以以国家意志全面移植常用的程序，虽没技术难题，但要耗费大量人力。当然我认为值得。 但“"Code Morphing"的二进制编译技术”却提供了我们一个奇兵制胜的可能。龙芯…

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发表于:2007/1/31 20:35:41
标签：FPGA  CPLD  

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FPGA与CPLD

FPGA是一种高密度的可编程逻辑器件,自从Xilinx公司1985年推出第一片FPGA以来,FPGA的集成密度和性能提高很快,其集成密度最高达500万门/片以上,系统性能可达200MHz。由于FPGA器件集成度高,方便易用,开发和上市周期短,在数字设计和电子生产中得到迅速普及和应用,并一度在高密度的可编程逻辑器件领域中独占鳌头。 CPLD是由 GAL发展起来的 ,其主体结构仍是与或阵列 ,自从 90年代初 Lattice公司高性能的具有在系统可编程 ISP(In System Programmable)功能的 CPLD以来 ,CPLD发展迅速。具有 ISP功能的 CPLD器件…

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发表于:2007/1/31 20:33:46
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RTL级设计中的时钟与复位

时钟和复位在数字系统设计中的重要性是勿庸置疑的.在RTL级设计中,要表示一个时钟并不复杂,在Verilog中只需像下面这样写就表示clk是一个时钟:EDA中国门户网站+aX:p)[!Bc^ always @ (posedge clk)EDA中国门户网站]"b6G'N9bO;P4Y*c 同样复位也不复杂，如： x'fW2z[1]L.`huqc2007同步复位：always @ (posedge clk)EDA中国门户网站'Z]9N}U;_ D,w8a 　　　　 if(rst) ‑w-p vB"H2}huqc2007 　　　　 复位操作； 3JIiE[1]I&{'yhuqc2007　　　　　　elseEDA中国门户网站F PF$U7Gat x 　　　 正常操作；EDA中国门户网…

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