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以下是关于标签 fpga波形仿真输出 的列表
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  • FPGA 10时钟周期AES算法加密数据 Verilog 2007-11-16 19:59:14

    时钟80M Fmax =83.69M 芯片等级C8 资源LE5.2K or LE 2.1k + RAM 16 M4k 数据宽度128位非PipeLine 数据吞吐效率128*80/10 = 1.024Gbits/S时钟125M Fmax =126.37M 芯片等级C8 LE 2.7k + RAM 20 M4k 数据…

    博客:wwh_nuaa | 类别:通信网络 | 评论:1

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