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VCCcore/GND,VCCIO/GND的选取方法参考

大家讨论下pad的问题吧

现在有一个项目,有很多pad,有analog 的,digit的
digit里又有clk的,又有平常普通的
还有很多Power pad,

我们要考虑IR drop, EM, 功耗,core的电流等问题

大家碰到这样一个项目,一般都是怎么考虑摆放的。。。。

一般考虑的步骤有哪几步的?

哪个大侠给点经验啊~~~~~
 
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1)analog 的pad无论信号还是电源,都依照使用说明
2)数字IO按照性能和设计要求选择晶振,时钟,输入,输出,上拉,下拉,施密特触发等不同IO
3)按照IO的功耗,SSO(取大的)决定IO power IO的个数
4)按照core功耗,IR drop(取大的)决定core power IO 的个数
5)其他特殊要求的IO,(参考手册)
 
 
(1)和(2)或其他一些板级方面的要求是由analog或前端,PCB系统方面的的人提供的吧
(3)和(4)可以说的详细点吗?
       (3)   如果我们已知
               IO Type 2mA 4mA 8mA 12mA  16mA 24mA
                              DF Value 0.02 0.03 0.09 0.18     0.3    0.56   
                              然后该怎么确定IO power IO 的个数呢?
       (4)   譬如我们设定VSS+VDD的IR drop为5%,然后整个chip的功耗为1w,怎么确定core power IO的个数?
(5)pad处的EM呢?是到后面如果发现问题了,再手动加吗?

谢谢
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(3.1) 算出所有数字IO的总功耗, 除以每个IO power IO的最大供电限度,就是最少需要的IO power IO个数,最好再多加20%

(3.2) 按照下面的方法计算SSO.
比如你有20个4mA IO, 50个8mA IO, 那么SDF=20x0.03+50x0.09=5.1
到IO使用说明上的找SDF与要求IO power IO个数的系数,比如ground 是1.0, power 是1.1
那么需要ground IO 个数= SDFx1.0 = 5.1 --> 6个
power IO个数= SDFx1.1 = 5.1x1.1 = 5.6 --> 6个

比较(3.1)和(3.2)的结果,取大的就是(3)的结果

(4.1)整个chip的功耗除以每个core power IO的最大供电限度,就是最少需要的core power IO个数,最好再多加10%

(4.2)把上面算出的core power IO个数均匀地摆放,借助工具检查IR drop,如果不理想的话,再调整,最后得到需要的core power IO个数

比较(4.1)和(4.2)的结果,取大的就是(4)的结果

(1) (2) (5)的答案正确
 
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首先非常谢谢,受益非浅啊~~~

学着去试试,看具体还有什么问题的再问


对了,突然有个很白痴的问题想问:
只要放pad处有空间,core power IO我尽量多的加,这样的话IR drop可以尽量小了,我想只是最后bonding的时候把它们bond在一起就ok了啊

请问这样有什么问题的.....
 
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To:陈涛
(3.2)为什么出来的SDF还要乘以系数的?
            还有定义的DF值怎么来确定的?我想一些specific cell同时跳变的数量和具体的chip有关的,工艺厂怎么得到这个数据的?

To:skyscar
    "摆放的方式也很重要。"这个对EM和IR drop都有很大的影响吧,还是指其他意思的?
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单片机系统的低功耗设计策略


单片机系统的低功耗设计策略
作者: 清华大学 陈萌萌 邵贝贝


摘要 嵌入式系统的低功耗设计需要全面分析各方面因素,统筹规划。在设计之初,各个因素往往是相互制约、相互影响的,一个降低系统功耗的措
施有时会带来其他方面的“负效应”。因此,降低系统整体功耗,需要仔细分析和计算。本文从硬件和应用软件设计两个方面,阐述一个以单片机为核
心的嵌入式系统低功耗设计时所需考虑的一些问题。


关键词 低功耗设计 硬件设计 应用软件设计 低功耗模式


  在嵌入式应用中,系统的功耗越来越受到人们的重视,这一点对于需要电池供电的便携式系统尤其明显。降低系统功耗,延长电池的寿命,就
是降低系统的运行成本。对于以单片机为核心的嵌入式应用,系统功耗的最小化需要从软、硬件设计两方面入手。
  随着越来越多的嵌入式应用使用了实时操作系统,如何在操作系统层面上降低系统功耗也成为一个值得关注的问题。限于篇幅,本文仅从硬件
设计和应用软件设计两个方面讨论。
1 硬件设计
  选用具有低功耗特性的单片机可以大大降低系统功耗。可以从供电电压、单片机内部结构设计、系统时钟设计和低功耗模式等几方面考察一款
单片机的低功耗特性。
1.1 选用尽量简单的CPU内核
  在选择CPU内核时切忌一味追求性能。8位机够用,就没有必要选用16位机,选择的原则应该是“够用就好”。现在单片机的运行速度越来越快,但
性能的提升往往带来功耗的增加。一个复杂的CPU集成度高、功能强,但片内晶体管多,总漏电流大,即使进入STOP状态,漏电流也变得不可忽
视;而简单的CPU内核不仅功耗低,成本也低。
1.2 选择低电压供电的系统
  降低单片机的供电电压可以有效地降低其功耗。当前,单片机从与TTL兼容的5 V供电降低到3.3 V、3 V、2 V乃至1.8 V供电。供电电压降下来,要
归功于半导体工艺的发展。从原来的3 μm工艺到现在的0.25、0.18、0.13 μm工艺, CMOS电路的门限电平阈值不断降低。低电压供电可以大大降低系
统的工作电流,但是由于晶体管的尺寸不断减小,管子的漏电流有增大的趋势,这也是对降低功耗不利的一个方面。
  目前,单片机系统的电源电压仍以5 V为主,而过去5年中,3 V供电的单片机系统数量增加了1倍,2 V供电的系统也在不断增加。再过五年,低电
压供电的单片机数量可能会超过5 V电压供电的单片机。如此看来,供电电压降低将是未来单片机发展的一个重要趋势。
1.3 选择带有低功耗模式的系统
  低功耗模式指的是系统的等待和停止模式。处于这类模式下的单片机功耗将大大小于运行模式下的功耗。过去传统的单片机,在运行模式下有
wait和stop两条指令,可以使单片机进入等待或停止状态,以达到省电的目的。
  等待模式下,CPU停止工作,但系统时钟并不停止,单片机的外围I/O模块也不停止工作;系统功耗一般降低有限,相当于工作模式的50%~
70%。

  停止模式下,系统时钟也将停止,由外部事件中断重新启动时钟系统时钟,进而唤醒CPU继续工作,CPU消耗电流可降到μA级。在停止模式
下,CPU本身实际上已经不消耗什么电流,要想进一步减小系统功耗,就要尽量将单片机的各个I/O模块关掉。随着I/O模块的逐个关闭,系统的功耗
越来越小,进入停止模式的深度也越来越深。进入深度停止模式无异于关机,这时的单片机耗电可以小于20 nA。其中特别要提示的是,片内RAM停
止供电后,RAM中存储的数据会丢失,也就是说,唤醒CPU后要重新对系统作初始化。因此在让系统进入深度停止状态前,要将重要系统参数保存在
非易失性存储器中,如EEPROM中。深度停止模式关掉了所有的I/O,可能的唤醒方式也很有限,一般只能是复位或IRQ中断等。
  保留的I/O模块越多,系统允许的唤醒中断源也就越多。单片机的功耗将根据保留唤醒方式的不同,降至1μA至几十μA之间。例如,用户可以保
留外部键盘中断,保留异步串行口(SCI)接收数据中断等来唤醒CPU。保留的唤醒方式越多,系统耗电也就会多一些。其他可能的唤醒方式还有实
时钟唤醒、看门狗唤醒等。停机状态较浅的情况下,外部晶振电路还是工作的。
  图1以Freescale的HCS08单片机为例,给出不同运行模式下的系统功耗。HCS08是8位单片机,有多个系列,各系列I/O模块数目有所不同,但低功
耗模式下的电流消耗大致相同。
图1 HCS08单片机各模式下的耗电
  以R系列单片机为例:在室温(25℃)下,不包括I/O口的负载,以2 V供电,将可编程锁相环时钟设为16 MHz(总线时钟8 MHz),典型电流值为
2.6 mA,当温度升高到85℃时,供电电流也升高到3.6 mA;而采用3 V供电,这一组数据升高至3.8 mA和4.8 mA。用2 V供电,直接使用外部晶振2 MHz
(总线时钟1 MHz)时,典型运行电流降至450 μA。在等待状态下,因时钟并没有停止,耗电情况和时钟频率有很大关系,节省的功耗有限;而进入
轻度停止(stop3),以外部中断唤醒,电流消耗在0. 5 μA左右。在中度停止态(stop2),功耗可进一步降低。使用内部1 kHz的时钟,保持1个运行的
时钟,周期性唤醒CPU,所增加的电流约为0.3 μA。在深度停止态(stop1),RAM的数据也不再保留,只能通过外部复位重启系统,此时的电流消耗
可降到20 nA。以上数据都是在室温下测量所得。当环境温度升高到85℃时,电流消耗可能增加3~5倍。
1.4 选择合适的时钟方案
  时钟的选择对于系统功耗相当敏感,设计者需要注意两个方面的问题:
  第一是系统总线频率应当尽量低。单片机内部的总电流消耗可分为两部分——运行电流和漏电流。理想的CMOS开关电路,在保持输出状态不变
时,是不消耗功率的。例如,典型的CMOS反相器电路,如图2所示,当输入端为零时,输出端为1,P晶体管导通,N晶体管截止,没有电流流过。而
实际上,由于N晶体管存在一定漏电流,且随集成度提高,管基越薄,漏电流会加大。温度升高,CMOS翻转阈电压会降低,而漏电流则随环境温度
的增高变大。在单片机运行时,开关电路不断由“1”变“0”、由“0”变“1”,消耗的功率是由单片机运行引起的,我们称之为“运行电流”。如图2所示,在两
只晶体管互相变换导通、截止状态时,由于两只管子的开关延迟时间不可能完全一致,在某一瞬间会有两只管子同时导通的情况,此时电源到地之
间会有一个瞬间较大的电流,这是单片机运行电流的主要来源。可以看出,运行电流几乎是和单片机的时钟频率成正比的,因此尽量降低系统时钟
的运行频率可以有效地降低系统功耗。

图2 典型的CMOS反相器
  第二是时钟方案,也就是是否使用锁相环、使用外部晶振还是内部晶振等问题。新一代的单片机,如飞思卡尔的HCS08系列单片机,片内带有内
部晶振,可以直接作为时钟源。使用片内晶振的优点是可以省掉片外晶振,降低系统的硬件成本;缺点是片内晶振的精度不高(误差一般在25%左
右,即使校准之后也可能有2%的相对误差),而且会增加系统的功耗。   现代单片机普遍采用锁相环技术,使单片机的时钟频率可由程序控制。
锁相环允许用户在片外使用频率较低的晶振,可以很大地减小板级噪声;而且,由于时钟频率可由程序控制,系统时钟可以在一个很宽的范围内调
整,总线频率往往能升得很高。但是,使用锁相环也会带来额外的功率消耗。
  单就时钟方案来讲,使用外部晶振且不使用锁相环是功率消耗最小的一种。
2 应用软件方面的考虑
  之所以使用“应用软件”的说法,是为了区分于“系统软件”或者“实时操作系统”。软件对于一个低功耗系统的重要性常常被人们忽略。一个重要的原
因是,软件上的缺陷并不像硬件那样容易发现,同时也没有一个严格的标准来判断一个软件的低功耗特性。尽管如此,设计者仍需尽量将应用的低
功耗特性反映在软件中,以避免那些“看不见”的功耗损失。
2.1 用“中断”代替“查询”
  一个程序使用中断方式还是查询方式对于一些简单的应用并不那么重要,但在其低功耗特性上却相去甚远。使用中断方式,CPU可以什么都不
做,甚至可以进入等待模式或停止模式;而查询方式下,CPU必须不停地访问I/O寄存器,这会带来很多额外的功耗。
2.2 用“宏”代替“子程序”
  程序员必须清楚,读RAM会比读Flash带来更大的功耗。正是因为如此,低功耗性能突出的ARM在CPU设计上仅允许一次子程序调用。因为CPU进
入子程序时,会首先将当前CPU寄存器推入堆栈(RAM),在离开时又将CPU寄存器弹出堆栈,这样至少带来两次对RAM的操作。因此,程序员可以
考虑用宏定义来代替子程序调用。对于程序员,调用一个子程序还是一个宏在程序写法上并没有什么不同,但宏会在编译时展开,CPU只是顺序执行
指令,避免了调用子程序。唯一的问题似乎是代码量的增加。目前,单片机的片内Flash越来越大,对于一些不在乎程序代码量大一些的应用,这种
做法无疑会降低系统的功耗。
2.3 尽量减少CPU的运算量
  减少CPU运算的工作可以从很多方面入手:将一些运算的结果预先算好,放在Flash中,用查表的方法替代实时的计算,减少CPU的运算工作量,
可以有效地降低CPU的功耗(很多单片机都有快速有效的查表指令和寻址方式,用以优化查表算法);不可避免的实时计算,算到精度够了就结束,
避免“过度”的计算;尽量使用短的数据类型,例如,尽量使用字符型的8位数据替代16位的整型数据,尽量使用分数运算而避免浮点数运算等。
2.4 让I/O模块间歇运行
  不用的I/O模块或间歇使用的I/O模块要及时关掉,以节省电能。RS232的驱动需要相当的功率,可以用单片机的一个I/O引脚来控制,在不需要通信
时,将驱动关掉。不用的I/O引脚要设置成输出或设置成输入,用上拉电阻拉高。因为如果引脚没有初始化,可能会增大单片机的漏电流。特别要注
意有些简单封装的单片机没有把个别I/O引脚引出来,对这些看不见的I/O引脚也不应忘记初始化。
3 结论
  一个成功的低功耗设计应该是硬件设计和软件设计的结合。从硬件设计开始,就应该充分意识到一个低功耗应用的特性,选择一款合适的单片
机,通过对其特性的了解,设计系统方案;在软件设计上,要考虑到低功耗编程的特殊性,并尽量使用单片机的低功耗模式。   限于篇幅,仅仅
讨论了低功耗设计中的一些常见问题,更多的问题只能靠设计者去实际分析和解决了。
参考文献

1 刘慧银,等. Motorola微控制器MC68HC08原理及其嵌入式应用,北京:清华大学出版社,2001
2 邵贝贝. 单片机嵌入式应用的在线开发方法. 北京:清华大学出版社,2004
3 Donnie Garcia, Scott Pape. MC9S08GB/GT Low?Power Modes. Freescale Semiconductor, Rev2. 2004
4 MC9S08GB/GT Data Sheet. Freescale Semiconductor, Rev.2.2, 2004
5 HCS08 Family Reference Manual. Freescale Semiconductor, 2003
6 Scott Pape. HC08 to HCS08 Transition. Freescale Semiconductor, 2004
7 Bill Lucas, Scott Pape. Configuring the System and Peripheral Clocks in the MC9S08GB/GT. Freescale Semiconductor, 2003
8 Scott Pape. S08 in Low Power Devices. Freescale Technology Forum, 2005
(收稿日期:2005-09-26)
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80C51上电复位和复位延时的时序分析

80C51上电复位和复位延时的时序分析
作者:河北通信职业技术学院 李学海   机械科学研究院 刘治山
            师慧公司 宋庆国
  80C51单片机的上电复位POR(Power On Reset)实质上就是上电延时复位,也就是在上电延时期间把单片机锁定在复位状态上。为什么在每次单
片机接通电源时,都需要加入一定的延迟时间呢?分析如下。
1 上电复位时序
  在单片机及其应用电路每次上电的过程中,由于电源回路中通常存在一些容量大小不等的滤波电容,使得单片机芯片在其电源引脚VCC和VSS之
间所感受到的电源电压值VDD,是从低到高逐渐上升的。该过程所持续的时间一般为1~100 ms(记作taddrise)。上电延时taddrise的定义是电源电压从
10% VDD上升到90% VDD所需的时间,如图1所示。
图1 上电延时taddrise和起振延时tosc实测结果
  在单片机电源电压上升到适合内部振荡电路运行的范围并且稳定下来之后,时钟振荡器开始了启动过程(具体包括偏置、起振、锁定和稳定几
个过程)。该过程所持续的时间一般为1~50 ms(记作tosc)。起振延时tosc的定义是时钟振荡器输出信号的高电平达到Vih1所需的时间。从图1所示的
实际测量图中也可以看得很清楚。这里的Vih1是单片机电气特性中的一个普通参数,代表XTAL1和RST引脚上的输入逻辑高电平。例如,对于常见的单
片机型号AT89C51和AT89S51,厂家给出的Vih1值为0.7VDD~VDD+0.5 V。
  从理论上讲,单片机每次上电复位所需的最短延时应该不小于treset。这里,treset等于上电延时taddrise与起振延时tosc之和,如图1所示。从实际
上讲,延迟一个treset往往还不够,不能够保障单片机有一个良好的工作开端。
  在单片机每次初始加电时,首先投入工作的功能部件是复位电路。复位电路把单片机锁定在复位状态上并且维持一个延时(记作TRST),以便
给予电源电压从上升到稳定的一个等待时间;在电源电压稳定之后,再插入一个延时,给予时钟振荡器从起振到稳定的一个等待时间;在单片机开
始进入运行状态之前,还要至少推迟2个机器周期的延时,如图2所示。

图2 复位信号释放的时机
2 上电复位电路3款
  上述一系列的延时,都是利用在单片机RST引脚上外接一个RC支路的充电时间而形成的。典型复位电路如图3(a)所示,其中的阻容值是原始手
册中提供的。在经历了一系列延时之后,单片机才开始按照时钟源的工作频率,进入到正常的程序运行状态。从图2所示的实测曲线中可以同时看到
4条曲线: VDD、Vrst、XTAL2和ALE。在电源电压以及振荡器输出信号稳定之后,又等待了一段较长的延时才释放RST信号,使得CPU脱离复位锁定状
态;而RST信号一旦被释放,立刻在ALE引脚上就可检测到持续的脉冲信号。
图3 上电复位延时电路
  由于标准80C51的复位逻辑相对简单,复位源只有RST一个(相对新型单片机来说,复位源比较单一),因此各种原因所导致的复位活动以及复
位状态的进入,都要依靠在外接引脚RST上施加一定时间宽度的高电平信号来实现。
  标准80C51不仅复位源比较单一,而且还没有设计内部上电复位的延时功能,因此必须借助于外接阻容支路来增加延时环节,如图3(a)所示。其
实,外接电阻R还是可以省略的,理由是一些CMOS单片机芯片内部存在一个现成的下拉电阻Rrst。例如,AT89系列的Rrst阻值约为50~200 kΩ;
P89V51Rx2系列的Rrst阻值约为40~225 kΩ,如图4所示。因此,在图3(a)基础上,上电复位延时电路还可以精简为图3(b)所示的简化电路(其中电容C的
容量也相应减小了)。
图4 复位引脚RST内部电路
  在每次单片机断电之后,须使延时电容C上的电荷立刻放掉,以便为随后可能在很短的时间内再次加电作好准备。否则,在断电后C还没有充分
放电的情况下,如果很快又加电,那么RC支路就失去了它应有的延迟功能。因此,在图3(a)的基础上添加一个放电二极管D,上电复位延时电路就变

成了如图3(c)所示的改进电路。也就是说,只有RC支路的充电过程对电路是有用的,放电过程不仅无用,而且会带来潜在的危害。于是附加一个放电
二极管D来大力缩短放电持续时间,以便消除隐患。二极管D只有在单片机断电的瞬间(即VCC趋近于0 V,可以看作VCC对地短路)正向导通,平时
一直处于反偏截止状态。
3 上电复位失败的2种案例分析
  假如上电复位延迟时间不够或者根本没有延时过程,则单片机可能面临以下2种危险,从而导致CPU开始执行程序时没有一个良好的初始化,甚
至陷入错乱状态。
① 在时钟振荡器输出的时钟脉冲还没有稳定,甚至还没有起振之前,就因释放RST信号的锁定状态而放纵CPU开始执行程序。这将会导致程序计数器
PC中首次抓取的地址码很可能是0000H之外的随机值,进而引导CPU陷入混乱状态。参考图5所示的实测信号曲线。
图5 在时钟未稳定前释放RST的情况
② 在电源电压还没有上升到合适范围之前(自然也是时钟尚未稳定之前),就释放RST信号的锁定状态,将会使单片机永远感受不到复位信号、经
历不到复位过程、包含PC在内的各个SFR内容没有被初始化而保留了随机值,从而导致CPU从一个随机地址开始执行程序,进而也陷入混乱状态。参
考图6所示的实测信号曲线。
图6 在电源和时钟均未稳定前释放RST的情况
4 外接监控器MAX810x
  为了提高单片机应用系统的稳定性,以及保障单片机应用系统的可靠复位,许多世界著名的半导体公司,陆续推出了种类繁多、功能各异、封
装微小的专用集成电路。本文仅以带有电源电压跌落复位和上电延迟复位功能的3脚芯片MAX810x为例,简单说明。
  MAX810x(x = L、M、J、T、S或R)是美国Maxim公司研制的一组CMOS电源监控电路,能够为低功耗微控制器MCU(或μC)、微处理器MPU(或μP)
或数字系统监视3~5 V的电源电压。在电源上电、断电和跌落期间产生脉宽不低于140 ms的复位脉冲。与采用分立元件或通用芯片构成的欠压检测电
路相比,将电压检测和复位延时等功能集成到一片3引脚封装的小芯片内,大大降低了系统电路的复杂性,减少了元器件的数量,显著提高了系统可
靠性和精确度。应用电路如图7所示。

图7 外接带延时功能的电压检测复位电路
  MAX810x系列产品提供高电平复位信号,并且还能提供6种固定的检测门限(4.63 V、4.38 V、4.00 V、3.08 V、2.93 V和2.63 V)。例如,MAX810M的检测
门限电压就是4.38 V,回差电压约为0.16 V。
  对于MAX810,在电源上电、断电或跌落期间,只要VCC还高于1.1 V,就能保证RESET引脚输出高电压。在VCC上升期间RESET维持高电平,直到
电源电压升至复位门限以上。在超过此门限后,内部定时器大约再维持240 ms后释放RESET,使其返回低电平。无论何时只要电源电压降低到复位门
限以下(即电源跌落),RESET引脚就会立刻变高。
  关于MAX810芯片的更多信息,可以参考该器件的产品手册。
参考文献
[1] 李学海. PIC单片机实用教程——基础篇/扩展篇. 北京: 北京航空航天大学出版社,2002.
[2] 李学海. EM78单片机实用教程——基础篇/扩展篇. 北京: 电子工业出版社,2003.
[3] 李学海. 凌阳8位单片机——基础篇/提高篇. 北京: 北京航空航天大学出版社,2005.
[4] 李学海. PIC单片机原理. 北京: 北京航空航天大学出版社,2004.
[5] 李学海. PIC单片机实践. 北京: 北京航空航天大学出版社,2004.
(收稿日期:2006-08-21)
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